CH374是一個(gè)USB總線的通用接口芯片，支持USB-HOST主機(jī)方式和USB-DEVICE/SLAVE設(shè)備方式，內(nèi)置3端口HUB根集線器，支持低速和全速的控制傳輸、批量傳輸、中斷傳輸以及同步/等時(shí)傳輸。在本地端，CH374具有8位數(shù)據(jù)總線和讀、寫、片選控制線以及中斷輸出，可以方便地掛接到單片機(jī)/DSP/MCU/MPU等控制器的系統(tǒng)總線上。除此之外，CH374還提供了節(jié)約I/O引腳的SPI串行通訊方式，通過3線或者4線SPI串行接口以及中斷輸出與單片機(jī)/DSP/MCU/MPU等相連接。
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低速和全速USB-HOST主機(jī)接口，兼容USB V2.0，外圍元器件只需要晶體和電容。 支持1.5Mbps低速和12Mbps 全速USB 通訊，兼容USB V2.0，外圍元器件只需要晶體和電容。 支持USB-HOST主機(jī)接口和USB-DEVICE 設(shè)備接口，支持動(dòng)態(tài)切換主機(jī)方式與設(shè)備方式。 CH374U芯片內(nèi)置3端口USB根集線器ROOT-HUB，可以同時(shí)連接和管理3個(gè)USB設(shè)備。 支持常用的低速和全速USB設(shè)備的控制傳輸、批量傳輸、中斷傳輸、同步/等時(shí)傳輸。 自動(dòng)檢測(cè)低速和全速USB設(shè)備的連接和斷開，提供設(shè)備連接和斷開的中斷通知。 內(nèi)置USB 信號(hào)線的阻抗匹配串聯(lián)電阻、USB設(shè)備端的上拉電阻、USB主機(jī)端的下拉電阻。 可選兩種單片機(jī)接口：6MB速度的8位被動(dòng)并行接口和3.5MB/28MHz速度的SPI串行接口。 并行接口包含8位數(shù)據(jù)總線，1位地址，3線控制：片選輸入、寫選通以及可選的讀選通。 并行接口只占用兩個(gè)地址位：索引地址口和數(shù)據(jù)口，讀寫數(shù)據(jù)口后內(nèi)部索引地址自動(dòng)遞增。 SPI 串行接口包含SPI片選、串行時(shí)鐘、串行輸入和輸出，并且SPI輸出與輸入可以并聯(lián)。 中斷輸出引腳是可選連接，低電平有效，可以通過查詢寄存器中的中斷標(biāo)志位代替。 提供輔助功能：可編程時(shí)鐘輸出，上電復(fù)位輸出以及可選的看門狗復(fù)位。 提供支持FAT12/FAT16/FAT32文件系統(tǒng)的U 盤文件級(jí)子程序庫，實(shí)現(xiàn)單片機(jī)讀寫U盤文件。 支持5V 電源電壓和3.3V電源電壓甚至3V電源電壓。 提供SOP-28、SSOP-20、SSOP-24 和SOP-16無鉛封裝，兼容RoHS，可以提供DIP28轉(zhuǎn)換板，引腳基本兼容CH375和CH372芯片。 封裝
產(chǎn)品種類:數(shù)字信號(hào)處理器和控制器-DSP,DSC
產(chǎn)品:DSPs
系列:ADSP-21479KCPZ-1A
商標(biāo)名:SHARC
安裝風(fēng)格:SMD/SMT
封裝/箱體:LFCSP-88
核心:SHARC
最大時(shí)鐘頻率:200MHz
L1緩存指令存儲(chǔ)器:-
L1緩存數(shù)據(jù)存儲(chǔ)器:-
程序存儲(chǔ)器大小:640kB
工作電源電壓:1.2V
最小工作溫度:-40C
最大工作溫度:+85C
封裝:Tray
商標(biāo):AnalogDevices
數(shù)據(jù)總線寬度:32bit
數(shù)據(jù)ROM大小:4Mbit
開發(fā)套件:ADZS-21479-EZLITE
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說明書類型:Fixed/FloatingPoint接口類型:DAI,DPI,I2C,SPI,UART
濕度敏感性:Yes
輸入/輸出端數(shù)量:16I/O
計(jì)時(shí)器/計(jì)數(shù)器數(shù)量:2Timer
產(chǎn)品類型:DSP-DigitalSignalProcessors&Controllers
工廠包裝數(shù)量:168
子類別:EmbeddedProcessors&Controllers
電源電壓-最大:1.26V
電源電壓-最小:1.14V
ADSP-2147xSHARC
處理器屬于SIMDSHARC系列DSP，采用ADI公司的SuperHarvard架構(gòu)。處理器與ADSP-2126x、
ADSP-2136x、ADSP-2137x、ADSP-2146x和ADSP-2116x
DSP以及SISD(單指令流-單數(shù)據(jù)流)模式的第一代ADSP2106xSHARC處理器源代碼兼容。這些處理器為32/40位浮
點(diǎn)處理器，針對(duì)高性能音頻應(yīng)用進(jìn)行了優(yōu)化，具有大容量
片內(nèi)SRAM，多條內(nèi)部總線可消除I/O瓶頸，并且提供創(chuàng)新
的數(shù)字應(yīng)用接口(DAI)。
內(nèi)核時(shí)鐘速度高達(dá)300MHz
5M片內(nèi)RAM
FIR、IIR和FFT加速器
16位寬SDRSDRAM外部存儲(chǔ)器接口
數(shù)字應(yīng)用接口(DAI)可實(shí)現(xiàn)用戶定制訪問外設(shè)，包括1個(gè)S/PDIFTx/Rx和1個(gè)8通道異步采樣速率轉(zhuǎn)換器。
全面增強(qiáng)的DMA引擎，包括分散/聚集DMA、延遲線DMA
實(shí)時(shí)時(shí)鐘(RTC)
8個(gè)串行端口(SPORT)，支持I2S、左對(duì)齊采樣對(duì)和TDM模式
看門狗定時(shí)器
移位寄存器
2個(gè)SPI兼容端口，支持主機(jī)和從機(jī)模式
UART和雙線接口
16個(gè)脈沖寬度調(diào)制(PWM)通道
3個(gè)全功能定時(shí)器
196引腳CSP_BGA和100ldLQFPEPAD封裝
商用、工業(yè)和汽車應(yīng)用溫度范圍
ADSP-21479KCPZ-1ASHARC
處理器是SIMDSHARC系列DSP采用AnalogDevices的超級(jí)哈佛建筑。處理器是源代碼與ADSP-2126x、ADSP-2136x、ADSP-2137x、ADSP-2146x和ADSP-2116xDSP以及第一個(gè)SISD（單指令、單數(shù)據(jù)）模式下的一代ADSP-2106xSHARC處理器。這些處理器是32位/40位浮點(diǎn)處理器針對(duì)高性能音頻應(yīng)用進(jìn)行了優(yōu)化，具有大型片上SRAM、多個(gè)內(nèi)部總線，以消除I/O瓶頸，以及一個(gè)創(chuàng)新的數(shù)字應(yīng)用接口(DAI)。表1顯示了ADSP-21479KCPZ-1A的性能基準(zhǔn)處理器。表2顯示了單個(gè)產(chǎn)品的特性供品。第1頁上的圖表顯示了兩個(gè)時(shí)鐘域（核心和I/O處理器）構(gòu)成ADSP-21479KCPZ-1A處理器。這核心時(shí)鐘域包含以下特性。
•兩個(gè)處理元件（PEx、PEy），每個(gè)都包含一個(gè)ALU、乘法器、移位器和數(shù)據(jù)寄存器文件
•兩個(gè)數(shù)據(jù)地址生成器（DAG1、DAG2）
•帶有指令緩存的程序定序器
•能夠支持2×64位數(shù)據(jù)的PM和DM總線
在每個(gè)核心處理器周期在內(nèi)存和核心之間傳輸
•一個(gè)帶引腳排列的周期性間隔定時(shí)器
•片上SRAM（高達(dá)5M位）
•一個(gè)用于仿真和邊界掃描的JTAG測(cè)試訪問端口。
JTAG通過用戶斷點(diǎn)提供軟件調(diào)試，允許靈活的異常處理
第1頁上的ADSP-2147x框圖還顯示了
外圍時(shí)鐘域（也稱為I/O處理器），
其中包含以下功能：ADSP-21479KCPZ-1A
•IOD0（外設(shè)DMA）和IOD1（外部端口DMA）
用于32位數(shù)據(jù)傳輸?shù)目偩�
•用于核心連接的外圍和外部端口總線
•帶有異步存儲(chǔ)器接口的外部端口
(AMI)和SDRAM控制器
•4個(gè)用于脈沖寬度調(diào)制(PWM)控制的單元
•1個(gè)內(nèi)存到內(nèi)存(MTM)單元，用于內(nèi)部到內(nèi)部
記憶轉(zhuǎn)移ADSP-21479KCPZ-1A
•數(shù)字應(yīng)用接口，包括四個(gè)精度
時(shí)鐘發(fā)生器(PCG)、輸入數(shù)據(jù)端口(IDP/PDAP)
對(duì)于串行和并行互連，一個(gè)S/PDIF
接收器/發(fā)送器、四個(gè)異步采樣率轉(zhuǎn)換器、八個(gè)串行端口、一個(gè)移位寄存器和一個(gè)靈活的
信號(hào)路由單元（DAISRU）。
•數(shù)字外設(shè)接口，包括兩個(gè)定時(shí)器，一個(gè)2-
有線接口，1個(gè)UART，2個(gè)串行外設(shè)接口
(SPI)、兩個(gè)精密時(shí)鐘發(fā)生器(PCG)、三個(gè)脈沖
寬度調(diào)制(PWM)單元和靈活的信號(hào)路由單元(DPISRU)。處理器使用兩個(gè)計(jì)算單元來提供顯著的
與以前的SHARC處理器相比，性能提高
DSP算法的范圍。憑借其SIMD計(jì)算硬件，處理器可以執(zhí)行1.8GFLOPS，運(yùn)行速度為
300兆赫。ADSP-21479KCPZ-1A
家族核心架構(gòu)
處理器在匯編級(jí)別與代碼兼容
ADSP-2146x、ADSP-2137x、ADSP-2136x、ADSP-2126x、
ADSP-21160和ADSP-21161，以及第一代
ADSP-2106xSHARC處理器。ADSP-2147x與ADSP-2126x、ADSP-2136x、ADSP2137x、ADSP-2146x和ADSP-2116xSIMDSHARC處理器具有相同的架構(gòu)特性，如圖2所示并在以下章節(jié)中詳細(xì)介紹。
SIMD計(jì)算引擎
處理器包含兩個(gè)計(jì)算處理元件
作為單指令多數(shù)據(jù)（SIMD）運(yùn)行
引擎。處理元素稱為PEX和PEY
每個(gè)都包含一個(gè)ALU、乘法器、移位器和寄存器文件。
PEX始終處于活動(dòng)狀態(tài)，PEY可以通過設(shè)置
MODE1寄存器中的PEYEN模式位。SIMD模式允許
處理器在兩個(gè)處理中執(zhí)行相同的指令
元素，但每個(gè)處理元素在不同的
數(shù)據(jù)。這種架構(gòu)在執(zhí)行數(shù)學(xué)密集型方面很有效
DSP算法。ADSP-21479KCPZ-1A
SIMD模式也會(huì)影響數(shù)據(jù)在
內(nèi)存和處理元件，因?yàn)閮杀兜臄?shù)據(jù)
需要帶寬來維持計(jì)算操作
處理元素。因此，進(jìn)入SIMD模式也會(huì)使內(nèi)存和處理之間的帶寬加倍
元素。使用DAG在SIMD中傳輸數(shù)據(jù)時(shí)
模式下，每個(gè)內(nèi)存或寄存器文件訪問都會(huì)傳輸兩個(gè)數(shù)據(jù)值。
外部SDRAM支持SIMD模式，但AMI不支持。
獨(dú)立的并行計(jì)算單元
在每個(gè)處理元件內(nèi)是一組計(jì)算單元。
計(jì)算單元由算術(shù)/邏輯單元組成
(ALU)、乘法器和移位器。這些單元在一個(gè)周期內(nèi)執(zhí)行所有操作。每個(gè)處理內(nèi)的三個(gè)單元
元素并行排列，最大限度地提高計(jì)算量
吞吐量。單條多功能指令并行執(zhí)行
ALU和乘法運(yùn)算。在SIMD模式下，并行
ALU和乘法器運(yùn)算發(fā)生在兩個(gè)處理元件中。這些計(jì)算單元支持IEEE32位單精度浮點(diǎn)，
40位擴(kuò)展精度浮點(diǎn)和32位定點(diǎn)數(shù)據(jù)格式。
定時(shí)器ADSP-21479KCPZ-1A
處理器包含一個(gè)核心定時(shí)器，可以產(chǎn)生周期性
軟件中斷。核心定時(shí)器可以配置為使用
FLAG3作為定時(shí)器到期信號(hào)。
數(shù)據(jù)寄存器文件
每個(gè)處理單元都包含一個(gè)通用數(shù)據(jù)寄存器文件。寄存器文件在計(jì)算之間傳輸數(shù)據(jù)
單元和數(shù)據(jù)總線，并存儲(chǔ)中間結(jié)果。這些
10端口、32寄存器（16個(gè)主要，16個(gè)輔助）寄存器文件，
結(jié)合處理器的增強(qiáng)型哈佛架構(gòu)，
允許計(jì)算單元之間不受約束的數(shù)據(jù)流和
內(nèi)部存儲(chǔ)器。PEX中的寄存器稱為
R0–R15，在PEY中為S0–S15。
上下文切換ADSP-21479KCPZ-1A
許多處理器的寄存器都有輔助寄存器
可以在中斷服務(wù)期間激活以實(shí)現(xiàn)快速上下文
轉(zhuǎn)變。寄存器文件中的數(shù)據(jù)寄存器，DAG寄存器，
并且乘法結(jié)果寄存器都有輔助寄存器。
主寄存器在復(fù)位時(shí)處于活動(dòng)狀態(tài)，而輔助寄存器
寄存器由模式控制寄存器中的控制位激活。
通用寄存器ADSP-21479KCPZ-1A
通用寄存器可用于通用任務(wù)。這
USTAT(4)寄存器允許簡(jiǎn)單的位操作（設(shè)置、清除、
用于所有外圍控制和狀態(tài)的切換、測(cè)試、異或）
寄存器。ADSP-21479KCPZ-1A
數(shù)據(jù)總線交換寄存器(PX)允許數(shù)據(jù)通過
在64位PM數(shù)據(jù)總線和64位DM數(shù)據(jù)總線之間，或
在40位寄存器文件和PM/DM數(shù)據(jù)總線之間。這些
寄存器包含處理數(shù)據(jù)寬度差異的硬件。
指令和四個(gè)操作數(shù)的單周期取指
該處理器具有增強(qiáng)的哈佛架構(gòu)
數(shù)據(jù)存儲(chǔ)器(DM)總線傳輸數(shù)據(jù)，程序存儲(chǔ)器(PM)總線傳輸指令和數(shù)據(jù)，具有獨(dú)立的程序和數(shù)據(jù)存儲(chǔ)器
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