介紹：EPM570T100C5N
MAX® II 系列瞬時接通、非易失性 CPLD 基于 0.18-μm、6 層金屬閃存工藝，密度從 240 到 2,210 個邏輯元件 (LE) (128到 2,210 個等效宏單元）和 8 Kbits 的非易失性存儲。 MAX II 設(shè)備與其他 CPLD 相比，提供高 I/O 數(shù)、快速性能和可靠的擬合架構(gòu)。具有 MultiVolt 內(nèi)核、用戶閃存 (UFM) 塊和增強的系統(tǒng)內(nèi)可編程性 (ISP)，MAX II 器件旨在減少成本和功耗，同時為總線等應(yīng)用提供可編程解決方案橋接、I/O 擴展、上電復(fù)位 (POR) 和排序控制以及器件配置控制。
特征：EPM570T100C5N
MAX II CPLD 具有以下特點：
■ 低成本、低功耗的 CPLD
■ 即時啟動、非易失性架構(gòu)
■ 待機電流低至 25 μA
■ 提供快速傳播延遲和時鐘到輸出時間
■ 提供四個全局時鐘，每個邏輯陣列塊 (LAB) 有兩個可用時鐘
■ UFM 塊高達 8 Kbits 用于非易失性存儲
■ MultiVolt 內(nèi)核可為以下任一設(shè)備啟用外部電源電壓
3.3V/2.5V 或 1.8V
■ MultiVolt I/O 接口支持 3.3-V、2.5-V、1.8-V 和 1.5-V 邏輯電平
■ 總線友好架構(gòu)，包括可編程轉(zhuǎn)換率、驅(qū)動強度、
總線保持和可編程上拉電阻
■ 施密特觸發(fā)器啟用抗噪輸入（每個引腳可編程）
■ I/O 完全符合 Peripheral Component Interconnect Special
興趣組 (PCI SIG) PCI 本地總線規(guī)范，3.3-V 的修訂版 2.2
在 66 MHz 下運行
■ 支持熱插拔EPM570T100C5N
■ 內(nèi)置聯(lián)合測試行動組 (JTAG) 邊界掃描測試 (BST) 電路
符合 IEEE 標準。 1149.1-1990
■ ISP 電路符合IEEE Std。 1532
功能說明：EPM570T100C5N
MAX® II 器件包含基于行和列的二維架構(gòu)，以實現(xiàn)自定義邏輯。行和列互連提供信號互連邏輯陣列塊 (LAB) 之間。邏輯陣列由 LAB 組成，每個 LAB 中有 10 個邏輯元件 (LE)。 LE 是一個提供有效實現(xiàn)用戶邏輯功能的小型邏輯單元。實驗室在整個設(shè)備中分為行和列。多軌互連提供 LAB 之間的快速粒度定時延遲。 LE 之間的快速路由為增加的邏輯級別與全局路由提供最小的時序延遲互連結(jié)構(gòu)。
MAX II 器件 I/O 引腳由位于 LAB 末端的 I/O 元件 (IOE) 供電設(shè)備外圍的行和列。每個 IOE 包含一個具有多項高級功能的雙向 I/O 緩沖區(qū)。 I/O 引腳支持施密特觸發(fā)輸入和各種單端標準，例如 66 MHz、32 位 PCI 和LVTTL。
MAX II 器件提供全局時鐘網(wǎng)絡(luò)。全球時鐘網(wǎng)絡(luò)包括四個全局時鐘線驅(qū)動整個設(shè)備，為所有設(shè)備提供時鐘設(shè)備內(nèi)的資源。全局時鐘線也可用于控制信號例如清除、預(yù)設(shè)或輸出使能
制造商: Intel
產(chǎn)品種類: CPLD - 復(fù)雜可編程邏輯器件
RoHS: 詳細信息
產(chǎn)品: MAX II
大電池數(shù)量: 440
邏輯數(shù)組塊數(shù)量——LAB: 57
最大工作頻率: 304 MHz
傳播延遲—最大值: 5.4 ns
輸入/輸出端數(shù)量: 76 I/O
工作電源電壓: 2.5 V, 3.3 V
最小工作溫度: 0 C
最大工作溫度: + 70 C
安裝風(fēng)格: SMD/SMT
封裝 / 箱體: TQFP-100
封裝: Tray
商標: Intel / Altera
存儲類型: Flash
濕度敏感性: Yes
邏輯元件數(shù)量: 570
工作電源電流: 55 mA
產(chǎn)品類型: CPLD - Complex Programmable Logic Devices
系列:EPM570T100C5N
工廠包裝數(shù)量: 90
子類別: Programmable Logic ICs
電源電壓-最大: 3.6 V
電源電壓-最小: 2.375 V
總內(nèi)存: 8192 bit
商標名: MAX II
零件號別名: 968702
單位重量: 3.774 g
以下物料均有現(xiàn)貨庫存：EPM570T100C5N
STM32F101RBT6
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