家庭概況：XCR3256XL-10TQG144C
CoolRunner XPLA3（擴(kuò)展可編程邏輯Array) 系列 CPLD 是針對低功耗系統(tǒng)的包括便攜式、手持式和功率敏感應(yīng)用。 CoolRunner XPLA3 系列的每個成員
包括快速零功耗 (FZP) 設(shè)計技術(shù)，兼具低功耗和高速度。通過這種設(shè)計技術(shù)，CoolRunner XPLA3 系列提供了真正的引腳對引腳
5.0 ns 的速度，同時提供功率待機(jī)時低于 56 μW，無需“渦輪位”或其他斷電方案。通過替換用于實現(xiàn)的傳統(tǒng)讀出放大器方法乘積項（一種已在 PLD 中使用的技術(shù)）
自雙極時代以來）具有級聯(lián)純 CMOS 鏈門，動態(tài)功率也大大低于任何其他 CPLD。 CoolRunner 器件是唯一的 TotalCMOS PLD，因為它們同時使用 CMOS 工藝技術(shù)
以及獲得專利的全 CMOS FZP 設(shè)計技術(shù)。這FZP 設(shè)計技術(shù)結(jié)合快速非易失性存儲器具有超低功耗 SRAM 影子存儲器的單元可提供
業(yè)界最低功耗的 3.3V CPLD 系列。
CoolRunner XPLA3 系列采用全 PLA 結(jié)構(gòu)用于功能塊內(nèi)的邏輯分配。解放軍提供最大的靈活性和邏輯密度，具有卓越的引腳鎖定能力，同時保持確定性時序。
CoolRunner XPLA3 CPLD 支持Xilinx® WebPACK™ 軟件和行業(yè)標(biāo)準(zhǔn) CAE工具（Mentor、Cadence/OrCAD、Exemplar Logic、Synopsys、
Viewlogic 和 Synplicity），使用帶有 ABEL 的 HDL 編輯器，VHDL、Verilog 和/或原理圖捕獲設(shè)計條目。設(shè)計驗證使用行業(yè)標(biāo)準(zhǔn)模擬器功能和時序仿真。支持開發(fā)
在多個個人計算機(jī) (PC)、Sun 和 HP 平臺上。
CoolRunner XPLA3 系列功能還包括行業(yè)標(biāo)準(zhǔn)，IEEE 1149.1，JTAG 接口通過哪些邊界掃描測試，在系統(tǒng)編程(ISP)，并且可能會發(fā)生設(shè)備的重新編程。這
CoolRunner XPLA3 CPLD 可進(jìn)行電重新編程使用行業(yè)標(biāo)準(zhǔn)的設(shè)備編程器。
CoolRunner XPLA3 架構(gòu)：XCR3256XL-10TQG144C
圖 1 顯示了一個實現(xiàn) CoolRunner XPLA3 架構(gòu)的 128 個宏單元設(shè)備的高級框圖。 CoolRunner XPLA3 架構(gòu)包括通過零功率互連的功能塊互連陣列 (ZIA)。 ZIA 是一個虛擬交叉點
轉(zhuǎn)變。每個功能塊都有來自 ZIA 的 40 個輸入和包含 16 個宏單元。從這個角度來看，這個架構(gòu)看起來很多其他 CPLD 架構(gòu)。是什么讓 CoolRunner
XPLA3系列的獨(dú)特之處在于每個功能內(nèi)部的邏輯分配塊，以及用于實現(xiàn)產(chǎn)品的設(shè)計技術(shù)條款。
功能塊架構(gòu)：XCR3256XL-10TQG144C
圖 3 說明了功能塊架構(gòu)。每個功能塊包含一個 PLA 數(shù)組，用于生成控制項、時鐘項和邏輯單元。 PLA 不同于 PAL
因為 PLA 有一個完全可編程的 AND 陣列，后跟一個完全可編程的 OR 陣列。 PAL 數(shù)組有一個固定 OR 數(shù)組，限制了靈活性。請參閱圖 2 了解
PAL 和 PLA 陣列的示例。 PLA陣列接收它的輸入直接來自 ZIA。有40對真并補(bǔ)充來自 ZIA 的輸入，為數(shù)組中的 48 個乘積項提供信息。在 48 個 P 項中，有 8 個
本地控制項 (LCT[0:7]) 可用作控制信號每個宏單元用作異步時鐘、復(fù)位、預(yù)設(shè)和輸出使能。如果不需要作為控制項，
這些 P-Terms 可以加入其他 40 個 P-Terms 作為附加邏輯資源。在每個功能塊中有 8 個折返 NAND 乘積項，可用于合成增加的邏輯
密度以支持更廣泛的邏輯方程。這個功能可以由用戶在軟件中禁用。與未使用的控件一樣P-Terms，未使用的折返 NAND P-Terms 可以用作
額外的邏輯資源。每個宏單元有 16 個高速 P 項可用于速度關(guān)鍵邏輯。如果比單個 P-Term 更寬宏單元需要邏輯，47 個額外的 P 項可以
在 VFM（可變功能多路復(fù)用器）之前求和。 VFM 通過在輸入之前實現(xiàn)一些兩個輸入邏輯功能來增加邏輯優(yōu)化宏單元（見圖 4）。
每個宏單元可支持組合或注冊邏輯。宏單元寄存器容納異步預(yù)設(shè)和重置，以及“開機(jī)”初始狀態(tài)。一個硬件還為 D 或 T 類型寄存器提供時鐘使能，
當(dāng)寄存器時鐘輸入用作鎖存使能時宏單元寄存器配置為鎖存功能。
特征：XCR3256XL-10TQG144C
•快速零功耗（FZP）設(shè)計技術(shù)可提供
超低功耗和極高的速度
-25°C時的典型待機(jī)電流為17至18μA
•創(chuàng)新的CoolRunner™XPLA3架構(gòu)
結(jié)合了高速和極高的靈活性
•基于業(yè)界首個TotalCMOS PLD-兩者
CMOS設(shè)計與工藝技術(shù)
•先進(jìn)的0.35μ五層金屬EEPROM工藝
-保證1,000個擦除/編程周期
-保證20年的數(shù)據(jù)保留
•使用JTAG IEEE的3V，系統(tǒng)內(nèi)可編程（ISP）
1149.1界面
-全邊界掃描測試（IEEE 1149.1）
-快速的編程時間
•支持復(fù)雜的異步時鐘
-16個產(chǎn)品術(shù)語時鐘和4個本地控制術(shù)語
每個功能塊的時鐘
-四個全局時鐘和一個通用控制項
每個設(shè)備的時鐘
•在設(shè)計變更期間出色的引腳保持力
•提供商業(yè)級和擴(kuò)展電壓
（2.7V至3.6V）工業(yè)級
•5V耐壓I / O引腳
•輸入寄存器建立時間為2.5 ns
•單遍邏輯可擴(kuò)展到48個乘積項
•5.0 ns的高速引腳間延遲
•每個輸出的擺率控制
•100％可路由
•安全位可防止未經(jīng)授權(quán)的訪問
•支持熱插拔功能
•使用Xilinx或行業(yè)進(jìn)行設(shè)計輸入/驗證
標(biāo)準(zhǔn)CAE工具
•創(chuàng)新的控制術(shù)語結(jié)構(gòu)提供：
-異步宏單元時鐘
-異步宏單元寄存器預(yù)設(shè)/重置
-每個宏單元的時鐘使能控制
•每個功能塊四個輸出使能控件
•折返NAND用于綜合優(yōu)化
•通用三態(tài)，方便“釘床”測試
•提供芯片級BGA，F(xiàn)ineline BGA和QFP
包。無鉛可用于大多數(shù)封裝類型。
有關(guān)更多信息，請參見Xilinx Packaging。
制造商: Xilinx
產(chǎn)品種類: CPLD - 復(fù)雜可編程邏輯器件
RoHS: 詳細(xì)信息
產(chǎn)品: CoolRunner XPLA3
大電池數(shù)量: 256
邏輯數(shù)組塊數(shù)量——LAB: 2
最大工作頻率: 154 MHz
傳播延遲—最大值: 7 ns
輸入/輸出端數(shù)量: 120 I/O
工作電源電壓: 3 V to 3.6 V
最小工作溫度: 0 C
最大工作溫度: + 70 C
安裝風(fēng)格: SMD/SMT
封裝 / 箱體: TQFP-144
存儲類型: EEPROM
系列:XCR3256XL-10TQG144C
商標(biāo): Xilinx
柵極數(shù)量: 6000
濕度敏感性: Yes
邏輯元件數(shù)量: 2
工作電源電流: 30 mA
產(chǎn)品類型: CPLD - Complex Programmable Logic Devices
工廠包裝數(shù)量: 60
子類別: Programmable Logic ICs
電源電壓-最大: 3.6 V
電源電壓-最小: 3 V
單位重量: 21.105 g
以下物料均有現(xiàn)貨庫存：XCR3256XL-10TQG144C
STM32F101RBT6
STM32F103CBT6
STM32F103C8T6
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XCR3256XL-10TQG144C
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TPS54260DGQR
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TPS54318RTER
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TPS548A20RVER
TPS5401DGQR
TPS5402DR
TPS5403DR
TPS54040DGQR
