CPU/視頻總線到低功耗電流模式MPL連接的雙路連接收發(fā)器
發(fā)布時(shí)間:2021/10/7 0:26:34 訪問(wèn)次數(shù):313
在650uA時(shí)的MPL連接速率為160Mbps,MPL-0滿足MPL物理層指標(biāo),能配置成并串或串并轉(zhuǎn)換器,具有串行8位照相機(jī)接口,連接降功耗模式降低靜態(tài)功耗到10uA以下,工作電壓1.7-3.1V和2.9-3.1V,接口電平為1.8-3.0V.LM2501是小型24L UCSP封裝(3.5x4.5x0.6mm).
LM2502是采用現(xiàn)有CPU/視頻總線到低功耗電流模式MPL連接的雙路連接收發(fā)器.
主收發(fā)器除了一個(gè)應(yīng)用處理器或基帶處理器外,還能把LVCMOS電平轉(zhuǎn)換成串行MPL電平,以便在柔性電纜和PCB上的導(dǎo)線上發(fā)送到靠近顯示器模塊的從收發(fā)器.
組合邏輯區(qū)塊有多達(dá)8個(gè)輸入端,一個(gè)ALM能實(shí)現(xiàn)兩種獨(dú)立的功能,每種有不同的寬度,包括有6個(gè)輸入的任何功能和7輸入的某種功能.
每個(gè)ALM還包括有兩個(gè)可編程的寄存器,兩個(gè)加法器,運(yùn)載鏈,加法器子目錄鏈和能更有效使用器件的邏輯功能的寄存器鏈.
這種創(chuàng)新的邏輯區(qū)塊在更小的物理面積能提供更多的邏輯功能,提供更快的器件性能,比以前的FPGA結(jié)構(gòu)更強(qiáng)2.5倍.Stratix II器件的邏輯元(LE)比Stratix FPGA多兩倍,接近180000個(gè)LE.
(素材來(lái)源：eccn和ttic.如涉版權(quán)請(qǐng)聯(lián)系刪除。特別感謝）
在650uA時(shí)的MPL連接速率為160Mbps,MPL-0滿足MPL物理層指標(biāo),能配置成并串或串并轉(zhuǎn)換器,具有串行8位照相機(jī)接口,連接降功耗模式降低靜態(tài)功耗到10uA以下,工作電壓1.7-3.1V和2.9-3.1V,接口電平為1.8-3.0V.LM2501是小型24L UCSP封裝(3.5x4.5x0.6mm).
LM2502是采用現(xiàn)有CPU/視頻總線到低功耗電流模式MPL連接的雙路連接收發(fā)器.
主收發(fā)器除了一個(gè)應(yīng)用處理器或基帶處理器外,還能把LVCMOS電平轉(zhuǎn)換成串行MPL電平,以便在柔性電纜和PCB上的導(dǎo)線上發(fā)送到靠近顯示器模塊的從收發(fā)器.
組合邏輯區(qū)塊有多達(dá)8個(gè)輸入端,一個(gè)ALM能實(shí)現(xiàn)兩種獨(dú)立的功能,每種有不同的寬度,包括有6個(gè)輸入的任何功能和7輸入的某種功能.
每個(gè)ALM還包括有兩個(gè)可編程的寄存器,兩個(gè)加法器,運(yùn)載鏈,加法器子目錄鏈和能更有效使用器件的邏輯功能的寄存器鏈.
這種創(chuàng)新的邏輯區(qū)塊在更小的物理面積能提供更多的邏輯功能,提供更快的器件性能,比以前的FPGA結(jié)構(gòu)更強(qiáng)2.5倍.Stratix II器件的邏輯元(LE)比Stratix FPGA多兩倍,接近180000個(gè)LE.
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