ADSPTigerSHARC芯片TS101S及其應(yīng)用
發(fā)布時間:2007/4/23 0:00:00 訪問次數(shù):503
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ADSP Tiger SHARC芯片TS101S及其應(yīng)用
摘要：ADSP Tiger SHARC系列中的TS101S是AD公司最新推出的高性能定／浮點(diǎn)數(shù)字信號處理器。文章利用FBLMS算法在輸入信號為高度相關(guān)性時仍然具有較好的收斂速度這一特點(diǎn)，進(jìn)而通過FBLMS算法在TS101S上實(shí)現(xiàn)了自適應(yīng)濾波，并在EZ-KIT開發(fā)板上測試通過，同時驗(yàn)證了該算法抑制同頻窄帶信號對雷達(dá)干擾的有效性。
關(guān)鍵詞：ADSP Tiser SHARC；FBLMS；窄帶干擾；TS101S
１ 引言
利用數(shù)字信號處理器（ＤＳＰ）來進(jìn)行模擬信號的處理同時具有很大的優(yōu)越性，其主要表現(xiàn)有精度高，靈活性大，可靠性好等方面。它不但可以廣泛應(yīng)用于通信系統(tǒng)、圖形／圖像處理、雷達(dá)聲納、醫(yī)學(xué)信號處理等實(shí)時信號處理領(lǐng)域。而且隨著人們對實(shí)時信號處理要求的不斷提高和大規(guī)模集成電路技術(shù)的迅速發(fā)展，數(shù)字信號處理器也發(fā)生著日新月異的變革。就ＡＤ公司而言，繼１６－ｂｉｔ定點(diǎn)ＡＤＳＰ２１ｘｘ和３２－ｂｉｔ浮點(diǎn)ＡＤＳＰ２１ｘｘｘ系列之后，日前又推出了ＡＤＳＰ Ｔｉｇｅｒ ＳＨＡＲＣ系列的新型器件。這種Ｔｉｇｅｒ ＳＨＡＲＣ系列器件是基于ＡＤ２１０６ｘ的下一代高性能芯片，其內(nèi)部集成有更大容量的ＲＡＭ，它可以在單周期內(nèi)執(zhí)行４條指令，且可以很方便地實(shí)現(xiàn)多片并行處理系統(tǒng)的擴(kuò)展，這些新添的特性更增加了高速實(shí)時信號處理的可行性。本文將介紹該系列中的ＴＳ１０１Ｓ芯片，以及利用該芯片實(shí)現(xiàn)ＦＢＬＭＳＦｒｅｑｕｅｎｃｙ－ｄｏｍａｉｎ Ｂｌｏｃｋ ＬＭＳ算法的自適應(yīng)預(yù)測濾波的設(shè)計(jì)方法。此外，筆者還在ＥＺ－ＫＩＴ開發(fā)板上測試通過并驗(yàn)證了該算法抑制同頻窄帶信號對雷達(dá)干擾的有效性。
２�。裕樱保埃保酉到y(tǒng)器件的結(jié)構(gòu)性能
２�。裕樱保埃保酉到y(tǒng)器件的結(jié)構(gòu)性能
２．１ 結(jié)構(gòu)特點(diǎn)
ＴＳ１０１Ｓ的系統(tǒng)結(jié)構(gòu)邏輯框圖如圖１所示。ＴＳ１０１Ｓ依舊采用超級哈佛結(jié)構(gòu)（ＳＨＡＲＣ），并運(yùn)用流水線技術(shù)，目前可以達(dá)到８級流水線（３級取指５級執(zhí)行），其結(jié)構(gòu)特點(diǎn)如下：
●具有特殊的指令集和較長的指令字，一個指令字可以同時控制芯片內(nèi)多個功能單元的操作；
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摘要：ADSP Tiger SHARC系列中的TS101S是AD公司最新推出的高性能定／浮點(diǎn)數(shù)字信號處理器。文章利用FBLMS算法在輸入信號為高度相關(guān)性時仍然具有較好的收斂速度這一特點(diǎn)，進(jìn)而通過FBLMS算法在TS101S上實(shí)現(xiàn)了自適應(yīng)濾波，并在EZ-KIT開發(fā)板上測試通過，同時驗(yàn)證了該算法抑制同頻窄帶信號對雷達(dá)干擾的有效性。
關(guān)鍵詞：ADSP Tiser SHARC；FBLMS；窄帶干擾；TS101S
１ 引言
利用數(shù)字信號處理器（ＤＳＰ）來進(jìn)行模擬信號的處理同時具有很大的優(yōu)越性，其主要表現(xiàn)有精度高，靈活性大，可靠性好等方面。它不但可以廣泛應(yīng)用于通信系統(tǒng)、圖形／圖像處理、雷達(dá)聲納、醫(yī)學(xué)信號處理等實(shí)時信號處理領(lǐng)域。而且隨著人們對實(shí)時信號處理要求的不斷提高和大規(guī)模集成電路技術(shù)的迅速發(fā)展，數(shù)字信號處理器也發(fā)生著日新月異的變革。就ＡＤ公司而言，繼１６－ｂｉｔ定點(diǎn)ＡＤＳＰ２１ｘｘ和３２－ｂｉｔ浮點(diǎn)ＡＤＳＰ２１ｘｘｘ系列之后，日前又推出了ＡＤＳＰ Ｔｉｇｅｒ ＳＨＡＲＣ系列的新型器件。這種Ｔｉｇｅｒ ＳＨＡＲＣ系列器件是基于ＡＤ２１０６ｘ的下一代高性能芯片，其內(nèi)部集成有更大容量的ＲＡＭ，它可以在單周期內(nèi)執(zhí)行４條指令，且可以很方便地實(shí)現(xiàn)多片并行處理系統(tǒng)的擴(kuò)展，這些新添的特性更增加了高速實(shí)時信號處理的可行性。本文將介紹該系列中的ＴＳ１０１Ｓ芯片，以及利用該芯片實(shí)現(xiàn)ＦＢＬＭＳＦｒｅｑｕｅｎｃｙ－ｄｏｍａｉｎ Ｂｌｏｃｋ ＬＭＳ算法的自適應(yīng)預(yù)測濾波的設(shè)計(jì)方法。此外，筆者還在ＥＺ－ＫＩＴ開發(fā)板上測試通過并驗(yàn)證了該算法抑制同頻窄帶信號對雷達(dá)干擾的有效性。
２ ＴＳ１０１Ｓ系統(tǒng)器件的結(jié)構(gòu)性能
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２．１ 結(jié)構(gòu)特點(diǎn)
ＴＳ１０１Ｓ的系統(tǒng)結(jié)構(gòu)邏輯框圖如圖１所示。ＴＳ１０１Ｓ依舊采用超級哈佛結(jié)構(gòu)（ＳＨＡＲＣ），并運(yùn)用流水線技術(shù)，目前可以達(dá)到８級流水線（３級取指５級執(zhí)行），其結(jié)構(gòu)特點(diǎn)如下：
●具有特殊的指令集和較長的指令字，一個指令字可以同時控制芯片內(nèi)多個功能單元的操作；
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