74LS112和74LS175簡介及邏輯功能測試
發(fā)布時間:2012/2/6 20:40:00 訪問次數(shù):25836
74LS112集成塊EC1200SJTS-33.333MHZ
74 LS112集成塊是一雙下降沿J-K觸發(fā)器。其邏輯符號和外引線排列如圖2.8.1(a)和
741,S112的邏輯功能如表2.8.3所列。
表2.8.3 74LS112功能表
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┃ 功能 ┃ 輸入 ┃ 輸出 ┃
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┃ ┃ 1 SD ┃ 1RD ┃ 1C ┃ 1J ┃ 1K ┃ io。+1 ┃ 1Q。+l ┃
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┃ 復位 ┃ 1 ┃ O ┃ × ┃ × ┃ × ┃ O ┃ 1 ┃
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┃ 置位 ┃ O ┃ 1 ┃ × ┃ × ┃ × ┃ 1 ┃ 0 ┃
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┃ 記1 ┃ 1 ┃ 1 ┃ + ┃ 1 ┃ O ┃ 1 ┃ O ┃
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┃ 記O ┃ 1 ┃ 1 ┃ + ┃ O ┃ 1 ┃ O ┃ 1 ┃
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┃ 計數(shù) ┃ 1 ┃ 1 ┃ 0 ┃ 1 ┃ 1 ┃ 1Q。 ┃ 1Qn ┃
┣━━━━╋━━━━━╋━━━━╋━━━━╋━━━━╋━━━━╋━━━━━╋━━━━━┫
┃保持 ┃ 1 ┃ 1 ┃ 0 ┃ O ┃ O ┃ 1Qn ┃ 1Q。 ┃
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在圖2.8.1中,1C,2C為時鐘輸入端;1J,1K,2J,2K為數(shù)據(jù)輸入端;1Q,io,2Q,2Q為輸出端;1R。,2R。為直接復位端(低電平有效);1SD.2SD為直接置位端(低電平有效)。
2. 74LS112的邏輯功能測試
(1)連接測試電路:首先將J-K觸發(fā)器7415112第16腳連往“+5 V”,8腳與“地”相連,再按圖2.8.2連接測試電路。1J,1K,1S.,和1RD分別接“高、低電平發(fā)生器”;1C接“單次脈沖”信號;io,io分別接“高低電平指示器”。
(2) 1SD和1RD功能測試:按表2.8.4要求改變1SD和1RD的狀態(tài)。并在1SD =0,1RD =1或1SD =1,1RD一0時任意改變1J,1K,1C的狀態(tài),觀察Li和L2燈亮情況。將1Q和1Q狀態(tài)記錄在該表中。
表2.8.4 74LS112的SD和RD功能測試
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┃ 1SD ┃ 1RD ┃ io ┃ 1Q ┃功能 ┃
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┃ 1 ┃ O ┃ ┃ ┃ ┃
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┃ O ┃ 1 ┃ ┃ ┃ ┃
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┃ 1 ┃ 1 ┃ ┃ ┃ ┃
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(3) 1J,1K邏輯功能測試:令1RD =1,SD =1,按表2.8.5要求輸入1J,1K和C,記錄測試結(jié)果。表中觸發(fā)器的初始狀態(tài)1Q?捎1SD,1RD的邏輯開關(guān)控制。
表2.8.5 74LS112的J.K邏輯功能測試
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┃ ┃ ┃ ┃ iQn+i ┃ ┃
┃ 1J ┃ 1K ┃ 1C ┃ ┃ 功能 ┃
┃ ┃ ┃ ┣━━━━━┳━━━━━┫ ┃
┃ ┃ ┃ ┃ 1Q。-o ┃ lQn =1 ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ O ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1—’0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O--l ┃ ┃ ┃ ┃
┃ 0 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1--0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ 1 ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1-}O ┃ ┃ ┃ ┃
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┃ ┃ ┃ O --1 ┃ ┃ ┃ ┃
┃ 1 ┃ 1 ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1 -*0 ┃ ┃ ┃ ┃
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74LS112集成塊EC1200SJTS-33.333MHZ
74 LS112集成塊是一雙下降沿J-K觸發(fā)器。其邏輯符號和外引線排列如圖2.8.1(a)和
741,S112的邏輯功能如表2.8.3所列。
表2.8.3 74LS112功能表
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┃ 功能 ┃ 輸入 ┃ 輸出 ┃
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┃ ┃ 1 SD ┃ 1RD ┃ 1C ┃ 1J ┃ 1K ┃ io。+1 ┃ 1Q。+l ┃
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┃ 復位 ┃ 1 ┃ O ┃ × ┃ × ┃ × ┃ O ┃ 1 ┃
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┃ 置位 ┃ O ┃ 1 ┃ × ┃ × ┃ × ┃ 1 ┃ 0 ┃
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┃ 記1 ┃ 1 ┃ 1 ┃ + ┃ 1 ┃ O ┃ 1 ┃ O ┃
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┃ 記O ┃ 1 ┃ 1 ┃ + ┃ O ┃ 1 ┃ O ┃ 1 ┃
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┃ 計數(shù) ┃ 1 ┃ 1 ┃ 0 ┃ 1 ┃ 1 ┃ 1Q。 ┃ 1Qn ┃
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┃保持 ┃ 1 ┃ 1 ┃ 0 ┃ O ┃ O ┃ 1Qn ┃ 1Q。 ┃
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在圖2.8.1中,1C,2C為時鐘輸入端;1J,1K,2J,2K為數(shù)據(jù)輸入端;1Q,io,2Q,2Q為輸出端;1R。,2R。為直接復位端(低電平有效);1SD.2SD為直接置位端(低電平有效)。
2. 74LS112的邏輯功能測試
(1)連接測試電路:首先將J-K觸發(fā)器7415112第16腳連往“+5 V”,8腳與“地”相連,再按圖2.8.2連接測試電路。1J,1K,1S.,和1RD分別接“高、低電平發(fā)生器”;1C接“單次脈沖”信號;io,io分別接“高低電平指示器”。
(2) 1SD和1RD功能測試:按表2.8.4要求改變1SD和1RD的狀態(tài)。并在1SD =0,1RD =1或1SD =1,1RD一0時任意改變1J,1K,1C的狀態(tài),觀察Li和L2燈亮情況。將1Q和1Q狀態(tài)記錄在該表中。
表2.8.4 74LS112的SD和RD功能測試
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┃ 1SD ┃ 1RD ┃ io ┃ 1Q ┃功能 ┃
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┃ 1 ┃ O ┃ ┃ ┃ ┃
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┃ O ┃ 1 ┃ ┃ ┃ ┃
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┃ 1 ┃ 1 ┃ ┃ ┃ ┃
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(3) 1J,1K邏輯功能測試:令1RD =1,SD =1,按表2.8.5要求輸入1J,1K和C,記錄測試結(jié)果。表中觸發(fā)器的初始狀態(tài)1Q?捎1SD,1RD的邏輯開關(guān)控制。
表2.8.5 74LS112的J.K邏輯功能測試
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┃ ┃ ┃ ┃ iQn+i ┃ ┃
┃ 1J ┃ 1K ┃ 1C ┃ ┃ 功能 ┃
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┃ ┃ ┃ ┃ 1Q。-o ┃ lQn =1 ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ O ┃ O ┃ ┃ ┃ ┃ ┃
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┃ ┃ ┃ 1—’0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O--l ┃ ┃ ┃ ┃
┃ 0 ┃ 1 ┃ ┃ ┃ ┃ ┃
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┃ ┃ ┃ 1--0 ┃ ┃ ┃ ┃
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┃ ┃ ┃ O—’l ┃ ┃ ┃ ┃
┃ 1 ┃ O ┃ ┃ ┃ ┃ ┃
┃ ┃ ┣━━━━━━╋━━━━━╋━━━━━╋━━━━┫
┃ ┃ ┃ 1-}O ┃ ┃ ┃ ┃
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┃ ┃ ┃ O --1 ┃ ┃ ┃ ┃
┃ 1 ┃ 1 ┃ ┃ ┃ ┃ ┃
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┃ ┃ ┃ 1 -*0 ┃ ┃ ┃ ┃
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