CD4520雙二進(jìn)制同步加法計(jì)數(shù)器集成電路
發(fā)布時(shí)間:2013/5/5 15:03:19 訪問次數(shù):5713
CD4520雙二進(jìn)制同步加法計(jì)數(shù)器集ATXMEGA32A4-AU成電路的特性及引腳排列
CD4520雙二進(jìn)制同步加法計(jì)數(shù)器的特性和CD4518完全相同,只是操作碼不同。CD4520采用16腳雙列直插式封裝,其引腳排列如圖5 - 75所示。
分頻系數(shù)可調(diào)的分頻器
分頻系數(shù)可調(diào)的分頻器電路如圖5.76(a)所示,它主要由信號(hào)轉(zhuǎn)換電路、電壓比較器及D觸發(fā)器等組成。電路中的IC1、IC2是雙4位二進(jìn)制加法計(jì)數(shù)器,它們與電阻網(wǎng)絡(luò)配合,可將輸入信號(hào)脈沖變?yōu)殡A梯波電壓。該電壓送人電壓比較器IC3的同相輸入端,與加在電壓比較器IC3反相輸入端的基準(zhǔn)電壓相比較,基準(zhǔn)電壓來自電源分壓,可通過多圈電位器RPi進(jìn)行設(shè)定。從計(jì)數(shù)器IC1、IC2狀態(tài)輸出端全為零開始,在輸入信號(hào)經(jīng)過幾個(gè)脈沖后,假定IC1、IC2輸出的階梯波電壓超過IC3所設(shè)定的基準(zhǔn)電壓,則電壓比較器IC3的輸出端由低電平翻轉(zhuǎn)為高電平。IC3輸出的高電平加在D觸發(fā)器IC4的D端,只有在IC4昀時(shí)鐘端CL所加脈沖的下一個(gè)上升沿到來時(shí),IC4的輸出端Q才會(huì)輸出正脈沖并同時(shí)使IC1、IC2復(fù)位,復(fù)位脈沖寬度正好等一個(gè)輸入信號(hào)的周期,如圖5 - 76 (b)所示。計(jì)數(shù)器復(fù)位后將再重復(fù)上述過程。
從上述過程中可以看出,設(shè)定的基準(zhǔn)電壓越高,電壓比較器發(fā)生翻轉(zhuǎn)所需階梯波電壓的階數(shù)也越多,對(duì)應(yīng)輸入信號(hào)的脈沖個(gè)數(shù)也越多,因此分頻系數(shù)也越大。
為保證分頻的精度,電源應(yīng)采取穩(wěn)壓措施。若電路共用一個(gè)電源,電路的最大分頻系數(shù)可達(dá)200左右。
CD4520雙二進(jìn)制同步加法計(jì)數(shù)器集ATXMEGA32A4-AU成電路的特性及引腳排列
CD4520雙二進(jìn)制同步加法計(jì)數(shù)器的特性和CD4518完全相同,只是操作碼不同。CD4520采用16腳雙列直插式封裝,其引腳排列如圖5 - 75所示。
分頻系數(shù)可調(diào)的分頻器
分頻系數(shù)可調(diào)的分頻器電路如圖5.76(a)所示,它主要由信號(hào)轉(zhuǎn)換電路、電壓比較器及D觸發(fā)器等組成。電路中的IC1、IC2是雙4位二進(jìn)制加法計(jì)數(shù)器,它們與電阻網(wǎng)絡(luò)配合,可將輸入信號(hào)脈沖變?yōu)殡A梯波電壓。該電壓送人電壓比較器IC3的同相輸入端,與加在電壓比較器IC3反相輸入端的基準(zhǔn)電壓相比較,基準(zhǔn)電壓來自電源分壓,可通過多圈電位器RPi進(jìn)行設(shè)定。從計(jì)數(shù)器IC1、IC2狀態(tài)輸出端全為零開始,在輸入信號(hào)經(jīng)過幾個(gè)脈沖后,假定IC1、IC2輸出的階梯波電壓超過IC3所設(shè)定的基準(zhǔn)電壓,則電壓比較器IC3的輸出端由低電平翻轉(zhuǎn)為高電平。IC3輸出的高電平加在D觸發(fā)器IC4的D端,只有在IC4昀時(shí)鐘端CL所加脈沖的下一個(gè)上升沿到來時(shí),IC4的輸出端Q才會(huì)輸出正脈沖并同時(shí)使IC1、IC2復(fù)位,復(fù)位脈沖寬度正好等一個(gè)輸入信號(hào)的周期,如圖5 - 76 (b)所示。計(jì)數(shù)器復(fù)位后將再重復(fù)上述過程。
從上述過程中可以看出,設(shè)定的基準(zhǔn)電壓越高,電壓比較器發(fā)生翻轉(zhuǎn)所需階梯波電壓的階數(shù)也越多,對(duì)應(yīng)輸入信號(hào)的脈沖個(gè)數(shù)也越多,因此分頻系數(shù)也越大。
為保證分頻的精度,電源應(yīng)采取穩(wěn)壓措施。若電路共用一個(gè)電源,電路的最大分頻系數(shù)可達(dá)200左右。
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