模擬輸入
發(fā)布時間:2012/2/19 18:28:42 訪問次數:961
模擬輸入的阻抗非常高，所以它們消耗的電流非常低。如果施加的電壓正常位于VD。或vs。之間的中點，它們消耗的電流會低于數字輸入。有時，如果數字輸入必須進入低功耗狀態(tài)，將數字輸入配置為模擬輸入是合適和可行的。
數字輸出AD22057R
對于數字輸出引腳，除了流過引腳為外部電路供電的電流之外，引腳不會消耗任何其他電流，請密切注意外部電路，以最大限度減少它們的電流消耗。
在I/O引腳使用高阻抗值上拉電阻
在I/O引腳（如MCLR、I2C信號、開關及電阻分壓器）上使用較大上拉電阻時，能有效降低功耗。例如，典型的I2C上拉電阻為4. 7kfl。但是，當I2C要發(fā)送數據并將線路下拉為低（低電平）時，對于3. 3V的工作電壓，每條總線會消耗大約700 VA的電流。通過將12C上拉電阻增大為lOkfl，可以將該電流減半。其代價就是最大I2C總線速度變低，但是在許多低功耗應用中，這種折中是值得的。在上拉電阻可以增大為非常高阻值(如lOOkQ或lMfl)的情況下，這種技術是特別有用的。
降低器件的工作電壓
降低器件的工作電壓( VD。)是一種非常有用的降低總功耗的措施。茌運行時，影響功耗的主要因素是時鐘速度。在休眠時，最主要的因素是晶體管中的泄漏電流。在較低電壓下，切換系統(tǒng)時鐘需要的電量較少，晶體管的泄漏電流也較小。
有一點非常重要，就是需要注意降低工作電壓是如何降低最大工作頻率的。請選擇允許應用以最高速度運行的最佳電壓。關于器件在給定電壓下的最大工作頻率，請參見各器件數據手冊。
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在I/O引腳使用高阻抗值上拉電阻
在I/O引腳（如MCLR、I2C信號、開關及電阻分壓器）上使用較大上拉電阻時，能有效降低功耗。例如，典型的I2C上拉電阻為4. 7kfl。但是，當I2C要發(fā)送數據并將線路下拉為低（低電平）時，對于3. 3V的工作電壓，每條總線會消耗大約700 VA的電流。通過將12C上拉電阻增大為lOkfl，可以將該電流減半。其代價就是最大I2C總線速度變低，但是在許多低功耗應用中，這種折中是值得的。在上拉電阻可以增大為非常高阻值(如lOOkQ或lMfl)的情況下，這種技術是特別有用的。
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降低器件的工作電壓( VD。)是一種非常有用的降低總功耗的措施。茌運行時，影響功耗的主要因素是時鐘速度。在休眠時，最主要的因素是晶體管中的泄漏電流。在較低電壓下，切換系統(tǒng)時鐘需要的電量較少，晶體管的泄漏電流也較小。
有一點非常重要，就是需要注意降低工作電壓是如何降低最大工作頻率的。請選擇允許應用以最高速度運行的最佳電壓。關于器件在給定電壓下的最大工作頻率，請參見各器件數據手冊。
模擬輸入的阻抗非常高，所以它們消耗的電流非常低。如果施加的電壓正常位于VD�；騰s。之間的中點，它們消耗的電流會低于數字輸入。有時，如果數字輸入必須進入低功耗狀態(tài)，將數字輸入配置為模擬輸入是合適和可行的。
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對于數字輸出引腳，除了流過引腳為外部電路供電的電流之外，引腳不會消耗任何其他電流，請密切注意外部電路，以最大限度減少它們的電流消耗。
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在I/O引腳（如MCLR、I2C信號、開關及電阻分壓器）上使用較大上拉電阻時，能有效降低功耗。例如，典型的I2C上拉電阻為4. 7kfl。但是，當I2C要發(fā)送數據并將線路下拉為低（低電平）時，對于3. 3V的工作電壓，每條總線會消耗大約700 VA的電流。通過將12C上拉電阻增大為lOkfl，可以將該電流減半。其代價就是最大I2C總線速度變低，但是在許多低功耗應用中，這種折中是值得的。在上拉電阻可以增大為非常高阻值(如lOOkQ或lMfl)的情況下，這種技術是特別有用的。
降低器件的工作電壓
降低器件的工作電壓( VD。)是一種非常有用的降低總功耗的措施。茌運行時，影響功耗的主要因素是時鐘速度。在休眠時，最主要的因素是晶體管中的泄漏電流。在較低電壓下，切換系統(tǒng)時鐘需要的電量較少，晶體管的泄漏電流也較小。
有一點非常重要，就是需要注意降低工作電壓是如何降低最大工作頻率的。請選擇允許應用以最高速度運行的最佳電壓。關于器件在給定電壓下的最大工作頻率，請參見各器件數據手冊。
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在I/O引腳（如MCLR、I2C信號、開關及電阻分壓器）上使用較大上拉電阻時，能有效降低功耗。例如，典型的I2C上拉電阻為4. 7kfl。但是，當I2C要發(fā)送數據并將線路下拉為低（低電平）時，對于3. 3V的工作電壓，每條總線會消耗大約700 VA的電流。通過將12C上拉電阻增大為lOkfl，可以將該電流減半。其代價就是最大I2C總線速度變低，但是在許多低功耗應用中，這種折中是值得的。在上拉電阻可以增大為非常高阻值(如lOOkQ或lMfl)的情況下，這種技術是特別有用的。
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