設(shè)計特點
發(fā)布時間:2012/4/21 19:33:00 訪問次數(shù):815
集成電路的工藝技術(shù)不斷推動TX-2B集成電路設(shè)計方法學的變革，工藝技術(shù)的每一次變革都推動了集成電路設(shè)計技術(shù)的一次飛躍。到目前為止，集成電路的設(shè)計技術(shù)已經(jīng)歷了4代。20世紀70～80年代之交，3～5llm工藝是集成電路的主體技術(shù)，與之相適應(yīng)的第一代ICCAD技術(shù)是以版圖輸入、設(shè)計檢查為特點；20世紀80年代中期，集成電路進入1. 5～3ym工藝階段，推動了以門陣列和標準單元為主的半定制設(shè)計方法的出現(xiàn)，不是以版圖設(shè)計為主，而是把主要精力轉(zhuǎn)向設(shè)計分析、驗證和可制造性，這一代設(shè)計技術(shù)以網(wǎng)表輸入、仿真驗證、自動布局布線、單元電路庫為特點，從此專用集成電路( ASIC)開始登上歷史舞臺；20世紀80年代末，90年代初，0. 6llmCMOS FPGA和EPLD出現(xiàn)，導(dǎo)致了可編程設(shè)計方法的出現(xiàn)，推動了以FPGA作為ASIC原形的設(shè)計，用增量設(shè)計法縮短了設(shè)計驗證的周期，這一代設(shè)計技術(shù)是以自頂向下( top-down)昀系統(tǒng)設(shè)計為主要特征，以高層次行為描述、行為仿真、綜合優(yōu)化為設(shè)計模式，并注意從系統(tǒng)級驗證設(shè)計和考慮設(shè)計的可測性；20世紀90年代中期，0. 35ym的深亞微米CMOS工藝導(dǎo)致了第四代設(shè)計技術(shù)的產(chǎn)生，即以CPU(或DSP) CORE為核心的系統(tǒng)集成(SOC)設(shè)計方法，注意編程和軟件的固化，以互連線作為問題的核心，用算法開發(fā)和數(shù)據(jù)流與控制流的方式描述系統(tǒng)，完成系統(tǒng)設(shè)計規(guī)范的結(jié)構(gòu)轉(zhuǎn)化，在虛擬的原形設(shè)計環(huán)境中驗證系統(tǒng)并實現(xiàn)系統(tǒng)集成，并將設(shè)計和測試融為一體。
集成電路的工藝技術(shù)不斷推動TX-2B集成電路設(shè)計方法學的變革，工藝技術(shù)的每一次變革都推動了集成電路設(shè)計技術(shù)的一次飛躍。到目前為止，集成電路的設(shè)計技術(shù)已經(jīng)歷了4代。20世紀70～80年代之交，3～5llm工藝是集成電路的主體技術(shù)，與之相適應(yīng)的第一代ICCAD技術(shù)是以版圖輸入、設(shè)計檢查為特點；20世紀80年代中期，集成電路進入1. 5～3ym工藝階段，推動了以門陣列和標準單元為主的半定制設(shè)計方法的出現(xiàn)，不是以版圖設(shè)計為主，而是把主要精力轉(zhuǎn)向設(shè)計分析、驗證和可制造性，這一代設(shè)計技術(shù)以網(wǎng)表輸入、仿真驗證、自動布局布線、單元電路庫為特點，從此專用集成電路( ASIC)開始登上歷史舞臺；20世紀80年代末，90年代初，0. 6llmCMOS FPGA和EPLD出現(xiàn)，導(dǎo)致了可編程設(shè)計方法的出現(xiàn)，推動了以FPGA作為ASIC原形的設(shè)計，用增量設(shè)計法縮短了設(shè)計驗證的周期，這一代設(shè)計技術(shù)是以自頂向下( top-down)昀系統(tǒng)設(shè)計為主要特征，以高層次行為描述、行為仿真、綜合優(yōu)化為設(shè)計模式，并注意從系統(tǒng)級驗證設(shè)計和考慮設(shè)計的可測性；20世紀90年代中期，0. 35ym的深亞微米CMOS工藝導(dǎo)致了第四代設(shè)計技術(shù)的產(chǎn)生，即以CPU(或DSP) CORE為核心的系統(tǒng)集成(SOC)設(shè)計方法，注意編程和軟件的固化，以互連線作為問題的核心，用算法開發(fā)和數(shù)據(jù)流與控制流的方式描述系統(tǒng)，完成系統(tǒng)設(shè)計規(guī)范的結(jié)構(gòu)轉(zhuǎn)化，在虛擬的原形設(shè)計環(huán)境中驗證系統(tǒng)并實現(xiàn)系統(tǒng)集成，并將設(shè)計和測試融為一體。
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